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AMD的羿龙系列的TLB缺陷是什么问题?

简单的说就是在极端情况下CPU（4和核心满负荷工作的情况下） 2缓与3缓之间的数据传输会发生错位，导致校验错误然后死机。

AMD已经有补丁来屏蔽这个错误的位置了 以下是原文 芯片上的translation lookaside buffer(TLB)以及L3 Cache两个部分。

AMD已经在他们的Linux核心补丁的文档中对这个错误作了技术性的描述，并说明通过这样的软件的补丁的方法可以导致很小的性能损失，大约在1%。

下面是这个技术性描述的原文： Erratum 298 will be described as follows: "The processor operation to change the essed or dirty bits of a page translation table entry in the L2 from 0b to 1b may not be atomic. A small window of time exists where other cached operations may cause the stale page translation table entry to be installed in the L3 before the modified copy is returned to the L2. In addition, if a probe for this cache line urs during this window of time, the processor may not set the essed or dirty bit and may corrupt data for an unrelated cached operation. The system may experience a machine check event reporting an L3 protocol error has urred. In this case, the MC4 status register (MSR 0000_0410) will be equal to B2000000_000B0C0F or BA000000_000B0C0F. The MC4 address register (MSR 0000_0412) will be equal to 26h." 处理器在L2的0b到1b替换一个页表转换中已被存取或者被污染的数据并不一定是一个原子操作（一个独立的操作）。

存在一个时间窗口，使得其他被缓存的操作，将先前的页表转换数据在其已经被修改的拷贝回到L2之前就被转移到L3当中。

另外，如果在这样的一个时间窗口查询了这段Cache line，处理器可能不会设置已经存取的或者被污染的数据，并且抄送错误的数据给一个不相关的缓存操作。

系统可能会开始自动效验事件，并且报告出现一个L3协议错误已经发生。

在这样的情况下，MC4状态寄存器（MSR 0000_0410）可能会等于B2000000_000B0C0F或者BA000000_000B0C0F。

MC4地址寄存器（MSR 0000_0412）将会等于26h. 这样的一个特殊的情况可能会导致数据的错误并且很有可能在四个核心都满载的情况下发生系统宕机。

技术上AMD习惯于把这个错误称之为298号错误，但是大家可能更多的把这个错误叫做TLB错误。

以上就是关于这个错误的一个大概情况，在我们开始测试之前有些东西是需要申明的。

有些人可能会被这个错误将有可能影响系统的稳定性的可能性给搞迷惑了（这句话本身就够迷惑人的）。

我们目前并没有很好的方法定量的来证明这个可能性发生的几率，但是我们可以提供一些金点子。

AMD说这样的问题发生非常的罕见，我们也相信这是一个事实。

CPU制造商在发布一款产品之前一定做了大量的测试，因为他们想避免问题的发生。

Barcelona Opteron在9月份被我们测试的时候也非常的稳定，我们也在之前测试Phenom的过程中遇到了一些稳定性方面的问题，但是我们都将这些问题归结到了尚未公开发售的ASUS主板上。

我们之前使用的ASUS的M3A32-MVP Deluxe在即使没有使用新的带有补丁的BIOS的情况下也十分的稳定，我们使用MSI的主板来做这次测试，在这个测试的过程中，即便是主板没有刷新使用带有补丁的BIOS，整个系统也没有出现一次宕机或者锁死。

按照CPU制造商的标准来说，TLB问题是一个大问题，因为CPU制造商的最重要的标准就是保证系统的稳定，这不是一个CPU的选择性特点，这是每一块CPU所必须做到的。

即便是某些错误在某些极限的状态下才会发生也是不允许的，因为少于100%的稳定是不可以接受的。

AMD帮助建立了这些标准，当然，整个业界也十分希望CPU制造商做到他们。

我们应当使用一些方法来降低TLB错误在PC的使用寿命中发生的几率，但是这个问题不应当由最终用户来考虑。

即使问题发生的几率在小，也没有人想系统的党机发生在他的头上，没有人想得到一个有缺陷的CPU。

这也就是为什么AMD直接要求主板厂商把打了补丁的BIOS作为他们主办的默认BIOS，而没有商量的余地，即便这样可能会导致系统性能的下降。

AMD还将会发布新的Overdriver调节软件的版本可以让用户可以关闭这个补丁，让用户选择稳定还是性能。

关于这个补丁的影响，很难的作出完整的评估，我们听说在补丁完成后可能会丧失10%-20%的性能，而且我们获知基于BIOS的补丁程序是通过屏蔽CPU内的问题逻辑单元来达到修复的目的的，但是注意L3并不是被完全屏蔽了。

stdole32.tlb是什么意思

这一般都是在Vista系统中出现的问题 解决办法： 1. 把你的office打上SP2补丁； 2. 去别的Xp系统电脑复制system32下的Stdole32.tlb文件替换了你的vista系统system32下的Stdole32.tlb文件，然后重启； 3. 安装Microsoft Office 2007 Service Pack 1 Fix 3 精简版（2009-02-06），可解决 Vista 环境下 Excel 的 stdole32.tlb 错误提示。

什么事TLB,有什么作用

TLB 解释一： OLE库文件，其中存放了OLE自动化对象的数据类型、模块和接口定义，自动化服务器通过TLB文件就能了解自动化对象的使用方法。

解释二： TLB的基本概念： TLB：Translation lookaside buffer,即旁路转换缓冲，或称为页表缓冲；里面存放的是一些页表文件（虚拟地址到物理地址的转换表）。

X86保护模式下的寻址方式：段式逻辑地址—〉线形地址—〉页式地址； 页式地址=页面起始地址+页内偏移地址； 对应于虚拟地址：叫page（页面）；对应于物理地址：叫frame（页框）； X86体系的系统内存里存放了两级页表，第一级页表称为页目录，第二级称为页表。

TLB和CPU里的一级、二级缓存之间不存在本质的区别，只不过前者缓存页表数据，而后两个缓存实际数据。

二：内部组成： 1：TLB在X86体系的CPU里的实际应用最早是从Intel的486CPU开始的，在X86体系的CPU里边，一般都设有如下4组TLB: 第一组：缓存一般页表（4K字节页面）的指令页表缓存（Instruction-TLB）； 第二组：缓存一般页表（4K字节页面）的数据页表缓存（Data-TLB）； 第三组：缓存大尺寸页表（2M/4M字节页面）的指令页表缓存（Instruction-TLB）； 第四组：缓存大尺寸页表（2M/4M字节页面）的数据页表缓存（Data-TLB）； 2：TLB命中和TLB失败 果 TLB中正好存放着所需的页表，则称为TLB命中（TLB Hit）；如果TLB中没有所需的页表，则称为TLB失败（TLB Miss）。

3：TLB条目数 即页表条目数，Entry! 4：TLB的联合方式 1〉全联合方式：Athlon XP 2〉4路联合方式：P4 当CPU执行机构收到应用程序发来的虚拟地址后，首先到TLB中查找相应的页表数据，如果TLB中正好存放着所需的页表，则称为TLB命中（TLB Hit）,接下来CPU再依次看TLB中页表所对应的物理内存地址中的数据是不是已经在一级、二级缓存里了，若没有则到内存中取相应地址所存放的数据。

既然说TLB是内存里存放的页表的缓存，那么它里边存放的数据实际上和内存页表区的数据是一致的，在内存的页表区里，每一条记录虚拟页面和物理页框对应关系的记录称之为一个页表条目（Entry），同样地，在TLB里边也缓存了同样大小的页表条目（Entry）。